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建筑工程
在图示逻辑电路中,触发器的初始状态是“1”态,当RD端保持高电平,在SD端加一负
在图示逻辑电路中,触发器的初始状态是“1”态,当RD端保持高电平,在SD端加一负
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2022-08-02
62
问题
在图示逻辑电路中,触发器的初始状态是“1”态,当RD端保持高电平,在SD端加一负脉冲时,触发器的新态是( )。
A.翻转到“0”态B.保持“1”态C.先翻转到“0”,马上回到“1”态D.无规律翻转不能确定
选项
A.翻转到“0”态
B.保持“1”态
C.先翻转到“0”,马上回到“1”态
D.无规律翻转不能确定
答案
B
解析
基本RS触发器
转载请注明原文地址:https://tihaiku.com/jzgc/1076122.html
本试题收录于:
结构基础考试一级题库注册结构工程师分类
结构基础考试一级
注册结构工程师
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